课程培训
利用千兆位级串行 I/O 进行设计培训课程

 利用千兆位级串行 I/O 进行设计培训课程

课程对象

FPGA 设计者和逻辑设计者

课程概要

1

  • 7 系列 FPGA 概述
  • 收发器简介
  • 收发器时钟控制和复位
  • 8B/10B 编码器和解码器
  • 实验1:8b/10b 运行不一致与旁路
  • 逗点和解串器对齐
  • 实验2:逗点和数据对齐

2

  • RX 弹性缓冲器和时钟校正
  • 实验3:时钟校正
  • 通道绑定
  • 实验4:通道绑定
  • 收发器向导概述
  • 实验 5: 收发器内核生成
  • 仿真和实现一个收发器设计
  • 实验 6: 收发器仿真和实现
  • 物理媒体副件(Physical Media Attachment)

3

  • 64B/66B 编码和变速箱
  • 实验7: 64B/66B 编码
  • 收发器板设计的考虑事项
  • 收发器测试与调试
  • 实验 8:使用 Xilinx 开发板进行系统实验或 IBERT 实验
  • 收发器应用实例



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