Essentials of FPGA Design（FPGA设计基础）培训课程

Who should attend?

Digital designers who have a working knowledge of HDL (VHDL or Verilog) and who are new to Xilinx FPGAs

Course Outline

 1

• Design Methodology Summary
• Basic FPGA Architecture
• Introduction to the Vivado Design Suite
• Vivado Design Flows
• Lab 1: Vivado Tool Overview
• Visualization for Analysis
• Designing with IP
• Basic Timing Constraints and Reports
• Lab 2: Vivado Synthesis and Implementation

 2

• Designing with FPGA Resources
• Clocking Resources
• Lab 3a: Designing with FPGA Resources
• Lab 3b: Creating an IP Integrator Subsystem Design
• Basic Timing Constraints (XDC)
• Timing Reports
• Lab 4: Basic XDC and Timing Reports
• Synchronous Design Techniques
• FPGA Configuration
• Appendix: SystemVerilog
• Appendix: Design Methodology
• Appendix: HDL Coding Techniques
• Appendix: Using the Pin Planning Environment

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服务优势：
丰富专家资源，精准匹配相关行业，相关项目技术精英，面向用户实际需求，针对性培训或咨询，互动式交流，案例教学，精品小班，实际工程项目经验分享，快捷高效，节省时间与金钱，少走弯路与错路。

专家力量：
中国科学院相关研究所高级研究人员
西门子，TI,vmware，MSC,Ansys，MDI，Mentor, candence,Altium,Atmel 、Freescale,达索，华为等
大型公司高级工程师，项目经理，技术支持专家
中科信软培训中心，资深专家或讲师
大多名牌大学，硕士以上学历，相关学历背景专业，理论素养高
多年实际项目实践，大型复杂项目实战案例分享，热情，乐于技术分享
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