Cadence Sigrity信号完整性分析培训课程
培训对象
信号完整性工程师、硬件设计工程师、高速PCB设计人员、需要掌握通道仿真与眼图分析的研发人员。
培训目标
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理解信号完整性的核心理论（传输线、反射、串扰、S参数）。
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掌握Sigrity SystemSI/Topology Explorer等工具的通道仿真方法。
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能够独立完成高速并行总线（DDR）与串行链路（SerDes）的SI分析。
培训内容介绍
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信号完整性基础：信号完整性的定义与研究范畴；高速信号的特征（上升时间、带宽）；传输线理论回顾（特性阻抗、传播延迟、反射、端接）；串扰机理（容性耦合、感性耦合、近端/远端串扰）；S参数基础（插入损耗、回波损耗、串扰参数）。
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Sigrity软件平台概述：Sigrity产品家族（SystemSI、PowerSI、OptimizePI、Aurora）的功能定位；Sigrity X的新特性（10倍速度提升、大规模处理能力）；用户界面与数据管理；与其他工具（Allegro、Clarity）的集成。
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预布局拓扑提取与仿真：Topology Explorer/Aurora工具的使用；从PCB布局前提取关键网络拓扑；IBIS模型的导入与分配；拓扑结构的编辑与参数化；预布局仿真的意义（设计规则制定）。
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IBIS模型详解：IBIS模型的基本结构（I/V曲线、V/T曲线、Pindata）；IBIS模型的获取与验证；IBIS-AMI模型的概念（用于SerDes均衡仿真）；模型分配与连接。
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并行总线仿真（SystemSI-PBA）：并行总线（DDR、QSPI）的仿真特点；写数据通道与读数据通道的建立；地址/控制总线的仿真；眼图生成与参数提取（建立时间、保持时间、眼高、眼宽）；时序分析（Setup/Hold Margin）。
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串行链路仿真（SystemSI-SLA）：串行链路（PCIe、SATA、USB、Ethernet）的仿真特点；发送端、通道、接收端的完整链路建模；AMI模型的均衡效果仿真（CTLE、DFE、FFE）；眼图与浴盆曲线（Bathtub Curve）的分析；误码率（BER）的预测。
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S参数在通道仿真中的应用：S参数的物理意义与格式；从PowerSI/Clarity提取S参数；S参数的无源性、因果性检查；S参数的级联与嵌入/去嵌入；S参数在SystemSI中的应用。
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串扰分析与优化：多耦合线的串扰建模；受害网与攻击网的设置；串扰引起的眼图闭合分析；串扰的抑制措施（布线隔离、防护地线、层叠优化）。
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后布局信号完整性分析：从已布线的PCB提取实际拓扑；过孔模型的精确提取（Via Wizard）；基于实际走线的通道仿真；后仿真结果与前仿真结果的对比验证。
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DDR4/DDR5仿真专题：DDR4/DDR5的仿真挑战（更高的速率、更低的电压）；Write Leveling与Read Training的仿真；VREF漂移的影响；地址/命令总线的时序分析；DDR接口的设计优化。
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PCIe/USB仿真专题：PCIe Gen4/5/6的仿真要求；链路训练与均衡协商的仿真；通道损耗预算计算；USB Type-C的CC逻辑与高速信号仿真；接收端抖动容忍度测试。
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综合实战项目：典型高速接口（如DDR4-3200、PCIe Gen4）的完整信号完整性分析，包含拓扑提取、IBIS模型分配、通道仿真、眼图分析、串扰评估与时序余量计算。
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